上课情况调查

为了保证上课质量，请同学们认真反馈问题，共同提高!

您的学号是?(可不填)

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您当前的年级是

大二

大三

大四

研一

已工作

其他

您拥有的数字前端设计基础

数字逻辑设计课程

数字集成电路设计课程

基于FPGA编程

Verilog硬件设计语言

已从事前端相关工作

其他

老师上课语速是否过快

稍快

合适

稍慢

其他

您认为前两次课程内容是否能够接受

大部分知识点均可接受

对很多概念不熟悉，但斌哥要求熟悉的基本流程可以接受

云里雾里，基本没有听懂

其他

您对本次课程和讲师有何建议(没有可填无)

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